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硬件工程師
職位年薪:25-50萬(wàn)
企業(yè)名稱(chēng):國(guó)內(nèi)知名通信企業(yè)
職位描述:
負(fù)責(zé)4G/5G無(wú)線(xiàn)通信產(chǎn)品基帶及整機(jī)系統(tǒng)電路設(shè)計(jì)與調(diào)試。
1.產(chǎn)品硬件方案評(píng)估與選擇,硬件技術(shù)規(guī)格定義與制定。
2.SOC/MCU/FPGA/ASIC小系統(tǒng),DDR/PHY/WALN/時(shí)鐘/RESET/電源電路設(shè)計(jì)與調(diào)試。
3.PCB Layout 指導(dǎo)/檢查/評(píng)審。
4.制作并維護(hù)管理BOM。
5.與軟件聯(lián)調(diào)并DEBUG軟硬件問(wèn)題,與結(jié)構(gòu)/ID工程師配合設(shè)計(jì)產(chǎn)品結(jié)構(gòu)。
6.支持并解決生產(chǎn)中各種硬件問(wèn)題。
任職要求:
1.本科及以上學(xué)歷,電子、通信、計(jì)算機(jī)等相關(guān)專(zhuān)業(yè),研究生三年、本科五年以上硬件設(shè)計(jì)工作經(jīng)驗(yàn);
2.熟悉無(wú)線(xiàn)通信產(chǎn)品基本架構(gòu)。
3.精通SOC/MCU/FPGA/ASIC以及DDR的外圍電路 。
4.精通SGMII /RGMII/ MII/ I2C/ SPI/PCIE/LVDS等接口原理與設(shè)計(jì)
5.精通DCDC/LDO/POE等電源設(shè)計(jì)。
6.精通時(shí)鐘/PLL/RESET/WATCHDOG等原理與設(shè)計(jì)。
7.精通EMC/ESD/SURGE防護(hù)與設(shè)計(jì)。
8.熟悉信號(hào)完整性/電源完整性原理以及規(guī)則。
9.思路清晰、具團(tuán)隊(duì)合作精神。
職位周期:38天

